JEDEC 5.1 presenta la memoria del futuro Memoria e•MMC
La última versión JEDEC 5.1 define una serie de características nuevas y mejoradas que serán útiles a los diseñadores de teléfonos inteligentes y otros dispositivos inteligentes.
Estos dispositivos se basan normalmente en procesadores de baja potencia ARM® y cada vez tienen mayor demanda de funciones mejoradas y capacidades de memoria - sin las cargas generales del controlador que suelen acompañar a estas.
Las últimas actualizaciones a los estándares eléctricos e•MMC definidos por la Asociación de Tecnología de Estado Sólido JEDEC (JEDEC Solid State Technology Association) han abierto toda una lista de funciones que apoyan una mejor funcionalidad de demanda de teléfonos inteligentes y usuarios de dispositivos móviles.
Las nuevas normas, que se pueden encontrar aquí: http://www.jedec.org/standards-documents/results/jesd84-b51, definen la cola de comandos (Command Queuing) para los CIs de memoria e•MMC, por primera vez. La cola de comandos permitirá a los chips de memoria analizar los comandos antes de ejecutarlos.
Otro cambio que mejorará la velocidad de memoria será, además, una mejora para el modo de interfaz HS400 definido en la versión 5.0 llamada Enhanced Mode Strobe (ESM)
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